-へたれ技術者のヤサグレ日記-(for精神衛生対策)
この日記はw3mとemacs(21.3.1)とSKKを使って書いています。
本日記の主要取扱項目は電子回路/UNIX/ネットワーク/アニメ/声優です。
「コピーコントロールCD」
という名称は売買春を援助交際と言う位に悪質です。不買運動実施中!
勝利は目前です!
日記が更新されていない時は激務で果てているか酔っ払っているかのどちらかです。
祝
となグラ!
アニメ化!
本日記に価値があるかどうかは各個人が判断するものであり強制したり、されたりするものではないと考える。
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2002年08月06日(火)
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CPLDフィットの極意
:
間違えて8bitアクセスのバスに16bitレジスタを作ってしまったので修正。
16bitレジスタを8bitレジスタに分解。
で、fitterにかけたらフィット出来なくてエラー。
既に基板が出来ているのでピン固定出来無いのはヤバイ。
かなり焦りながらソースを検討。
マクロセルが100個近く余っているし、P-Termだって40%も使っていないのにピン固定出来無い。
けど、他部署の人が作った回路ではマクロセルが2個しか余ってないのにピン固定出来たという話があるので、きっと自分のHDL記述が悪いに違いない。
つーことで、極意を教えてもらった。
いくつかあったが、複雑なノードはワザと展開させない方が良いらしい。
通常、fitterは何が何でも最適化しようとして全ての展開してしまう。
すると、バスラインに積和項が多数あると回路規模が爆発してしまう。
すると、ファンクションブロックの入力が不足してフィット出来なくなるらしい。
で、今回はこの件を頭に入れつつ上司のアドバイスでレジスタをバスラインに直接継ぐのをやめて、一旦、レジスタを集積するノードを設けて間接的にバスラインに接続した。
そうしたら何なくピン固定完了。
本来は、こういうこともEDAツールで自動的にやって欲しいんだけどな。
†
タイミングチャート清書ツール
:
タイミングチャート清書ツール
というものがあるらしい。
うっ。まぢ便利かも。
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以上、1 日分です。
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